Questões de Concursos - Questões Comentadas

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457941201458807

Ano: 2023Banca: FUNDATECOrganização: GHC-RSDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital

Você necessita determinar a potência consumida por um equipamento que está ligado a uma fonte de tensão de 20V de Corrente Contínua (CC). Você tem à disposição um multímetro e material básico de bancada (ferramentas, fios, conectores, entre outros). Qual o procedimento adequado para realizar a medida?

Deve-se medir a tensão que é fornecida pela fonte, selecionar o modo de medida em Volts CC (modo Voltímetro) no multímetro e acoplá-lo diretamente nos terminais de saída da fonte, que deve estar ligada e sem carga (desconectar o equipamento da fonte) e efetuar a leitura da tensão. Depois, desacoplar o multímetro da fonte, selecionar o modo de medida em Amperes CC (modo Amperímetro) e, usando o material de bancada, acoplar o multímetro em uma das saídas da fonte (ligada) com um dos terminais de alimentação do equipamento, de forma que, nessa condição, o multímetro esteja em série com o equipamento. Efetuar a leitura de Corrente. A potência consumida pelo equipamento será obtida diretamente por: leitura de corrente x leitura de tensão.

É necessário apenas medir a corrente na carga, selecionar o modo de medida em Amperes CC (modo Amperímetro) no multímetro e acoplá-lo diretamente nos terminais de alimentação do equipamento em paralelo à fonte ligada.

Deve-se medir a corrente que é fornecida pela fonte, selecionar o modo de medida em Amperes CC (modo Amperímetro) no multímetro e acoplá-lo diretamente nos terminais de saída da fonte, que deve estar ligada e sem carga (desconectar o equipamento da fonte) e efetuar a leitura da corrente. Depois, sem desacoplar o multímetro, selecionar o modo de medida em Volts CC (modo Voltímetro) e realizar a leitura da tensão. A potência será obtida por: leitura de corrente x leitura de tensão.

Não há um voltímetro nem um amperímetro para realizar as medidas, portanto não há como medi-las.

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457941200186193

Ano: 2014Banca: FAURGSOrganização: TJ-RSDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos

Texto associado

Considere para a questão, que /A, /B, /C, /D representam, respectivamente, a negação lógica das variáveis A, B, C, D; e que ‘.’ representa a operação lógica ‘E’; e que ‘+’ representa a operação lógica ‘OU’.

A função lógica de quatro variáveis S(A,B,C,D) é definida como S = (/A./B.C.D + /A.B.C./D + /A.B.C.D + /A./B.C./D) . A função S pode ser simplificada para

/B.C

A./C

B./D

/A.C

B./C

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457941200485175

Ano: 2010Banca: CESGRANRIOOrganização: PetrobrasDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital

Um circuito combinacional que apresenta três entradas lógicas, F, G e H, tem sua saída Y = FGH + FGH + FGH + FGH dada pela função

A expressão simplificada de Y é

FG + H

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457941200766278

Ano: 2012Banca: FCCOrganização: TRE-CEDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Eletrônica Digital | Álgebra Booleana e Circuitos Lógicos | Redes de Comunicação Industrial

O parâmetro abaixo, com capacidade máxima, que a saída de uma porta lógica pode acionar outras com segurança é

tPHL

IOS

VOH

IOH

fan-out

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457941201622074

Ano: 2025Banca: Instituto ConsulplanOrganização: TJ-RODisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital

Um circuito de iluminação é alimentado por uma tensão de 220 V e utiliza condutores de cobre com comprimento total (ida e volta) de 50 m. A corrente de carga do circuito é de 10 A, e a resistividade do cobre é ρ = 1,72 × 10−8 Ω ⋅ m. Considerando que o condutor possui uma seção transversal de 2,5 mm2 , calcule a queda de tensão no circuito (ΔV), e indique se ele atende ou não à norma.

(Considere que a norma NBR 5410 estabelece o limite máximo de queda de tensão de 4% da tensão nominal.)

ΔV = 4,56 V; não atende à norma.

ΔV = 3,44 V; atende à norma.

ΔV = 2,88 V; atende à norma.

ΔV = 4,12 V; não atende à norma.

ΔV = 3,44 V; não atende à norma.

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457941200501632

Ano: 2016Banca: INSTITUTO AOCPOrganização: EBSERHDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital

Em um projeto de eletrônica embarcada, um Engenheiro Eletricista encontrou um dispositivo lógico programável e, em sua análise, deve concluir sobre seu funcionamento para interpretar as funções previstas para ele. Com base nos conceitos de dispositivos lógico programáveis, assinale a alternativa correta.

A Macrocélula da Lógica de Saída (OLMC) não pode ser programada para complementar o bit resultante.

A PAL (Lógica de Arranjo Programável) apresenta estrutura AND e OR, porém as entradas das portas AND são programáveis.

A arquitetura interna de todos os dispositivos PAL (Lógica de Arranjo Programável) utiliza ULA com ADC de 16 bits e filosofia CISC em dois barramentos, sendo um de dados e outro de instruções, conforme tecnologia Harvard.

Os PLDs (Dispositivos Lógico Programáveis) são dispositivos programáveis que utilizam exclusivamente flip-flops do tipo D para implementar o registrador na macrocélula.

Todos os dispositivos GAL (Lógica de Arranjo Genérico) apresentam matriz de termos de saída, portas XOR, cristal ressonante programável e microcélulas de lógica de entrada em sua arquitetura interna.

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457941200662532

Ano: 2016Banca: CESPE / CEBRASPEOrganização: TCE-PRDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital | Transistores | Eletrônica Analógica

A respeito da família TTL (transistor-transistor logic) de circuitos lógicos, amplamente utilizada desde sua concepção, assinale a opção correta.

A série que utiliza diodos Schottky conectados entre a base e o coletor dos transistores permite que os transistores operem o máximo possível na saturação, o que aumenta a velocidade de chaveamento do circuito.

Em toda a família TTL, uma entrada desconectada se comporta como se o nível lógico 1 estivesse aplicado a ela.

Dispositivos da série 74LS apresentam menor atraso de propagação em comparação com os da série 74S.

A capacidade de fan-out dos dispositivos da família TTL é igual a vinte entradas.

A série TTL fast utiliza técnicas de fabricação de circuitos integrados que aumentam as capacitâncias entre os dispositivos internos, o que reduz o atraso de propagação.

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457941201423169

Ano: 2019Banca: VUNESPOrganização: UNICAMPDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital

Um determinado comportamento de um circuito lógico foi especificado com linguagens de descrição de hardware (HDL). Após o processo de síntese de alto nível, ferramentas computacionais determinaram um fluxo de dados (data path) e um fluxo de controle e estados (control path), usando RTL (register transfer logic), IP (intelectual property) Cores e outros recursos tecnológicos disponíveis em uma determinada arquitetura de FPGA. Foi realizada uma simulação digital pós-síntese que verificou que os resultados atenderam à especificação original. Entretanto, após a programação, o hardware real da FPGA não operou de forma correta, com falhas durante seu funcionamento.

A respeito desse processo, é correto afirmar que

as regras de mapeamento de pinos e recursos (mapping) estão implícitas na descrição comportamental via HDL e não devem ser especificadas. A ferramenta de síntese se encarrega de determinar a alocação desses recursos. O não funcionamento deve-se a algum problema na eletrônica do circuito integrado da FPGA.

a lógica sintetizada nesse processo deve funcionar em qualquer arquitetura de FPGA, independentemente do fabricante do circuito integrado, e o não funcionamento deve-se a algum problema na eletrônica do circuito integrado da FPGA.

as restrições e requisitos de tempo (timming) e restrições na alocação de pinos e terminais devem ser especificados de forma explícita para a ferramenta de síntese. Caso contrário, a ferramenta de síntese poderá alocar esses recursos de forma não compatível com a eletrônica. O não funcionamento deve-se a algum erro nessas especificações.

a lógica sintetizada nesse processo deve funcionar em qualquer arquitetura de FPGA de um mesmo fabricante. O não funcionamento deve-se a algum problema na etapa de mapping ou alocação de recursos da FPGA, que não foi especificada corretamente.

os fluxos de dados e de controle criados pela síntese de alto nível não possuem falhas, como comprovado pela simulação. Entretanto, a largura de dados dos barramentos deve ser explicitamente especificada para a ferramenta de síntese para que a implementação real opere como esperado. O não funcionamento deve-se a algum erro nessas especificações.

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457941201717958

Ano: 2010Banca: FGVOrganização: FIOCRUZDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital | Flip-Flops

Texto associado

Com relação ao FPGA (Field Programmable Gate Array), analise as afirmativas a seguir.

I. As lógicas são construídas pela programação de matrizes, sendo uma de portas AND e outra de portas OR.

II. O interfaceamento do FPGA com o exterior é feito através de buffers unidirecionais de entrada ou de saída.

III. Existem pacotes de desenvolvimento que permitem um projeto digital feito através de editor de esquemáticos, editor de diagrama de estados ou linguagem descritiva de hardware (HDL).

Assinale:

se somente as afirmativas II e III estiverem corretas.

se somente a afirmativa III estiver correta.

se somente a afirmativa II estiver correta.

se somente a afirmativa I estiver correta.

se somente as afirmativas I e III estiverem corretas.

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457941201961291

Ano: 2022Banca: FGVOrganização: Senado FederalDisciplina: Engenharia Eletrônica e Sistemas DigitaisTemas: Álgebra Booleana e Circuitos Lógicos | Eletrônica Digital

Uma simplificação da expressão booleana

A̅ B̅ C̅ + A̅ B C̅ + A B̅ C̅ D̅ + B̅ C D̅

é:

A̅ B + A C

A̅ B + B̅ C

A̅ B̅ + B̅ D̅

A̅ C̅ + B̅ D̅

A̅ C̅ + B̅ C

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